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디지털 논리회로설계
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디지털 논리회로설계

  • 이승호
  • |
  • 한티미디어
  • |
  • 2012-02-20 출간
  • |
  • 1015페이지
  • |
  • 260 X 198 mm
  • |
  • ISBN 9788964211120
★★★★★ 평점(10/10) | 리뷰(1)
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북스크린영상으로 만나보는 한 권의 책 이야기

출판사서평

본서에서는 전문대학과 학부과정에서 디지털 논리회로를 ALTERA Quartus II를 사용하여 실습할 수 있도록 풍부한 예제 중심으로 설명하였다.

제1장에서는 ALTERA Quartus II를 설치하는 법과 ALTERA FPGA 디바이스 구조에 대하여 설명하였다. 제2장부터 제5장까지는 ALTERA Quartus II를 사용하여 디지털 논리회로를 설계하는 과정을 4비트 adder 예제를 사용하여 알기 쉽고 일관성 있게 설명하였다. 제6장에서는 사용자가 ALTERA 디바이스에 프로그래밍 한 후에 이를 동작시키기 위하여 PCB 기판을 제작하는 매우 번거롭고 어려운 문제를 쉽게 해결할 수 있도록 (주)한백전자가 개발한 HBE-COMBO II 트레이닝 키트에 대하여 설명하였다. 제7장에서는 제2장부터 제5장까지에서 설계한 4비트 adder 예제를 ALTERA Quartus II의 Schematic Editor를 사용하여 설계한 후에 HBE- COMBO II 트레이닝 키트에 구현하는 과정에 대하여 알기 쉽게 설명하였다. 제8장에서 제18장까지는 4비트 adder, 4비트 subtractor, 4비트 multiplier 등을 ALTERA Quartus II의 Schematic Editor를 사용하여 설계한 후에 결과를 led, 7-segment, vfd 등으로 출력하는 과정에 대하여 알기 쉽게 설명하였다. 한편, 제19장에서는 ALTERA Quartus II의 VHDL 문법에 대하여 자세히 설명하였고 다양한 실습예제도 수록하였다. 제20장에서는 4비트 adder 예제를 ALTERA Quartus II의 VHDL을 사용하여 설계한 후에 HBE-COMBO II 트레이닝 키트에 구현하는 과정에 대하여 알기 쉽게 설명하였으며, ModelSim을 사용한 시뮬레이션 사용법도 알기 쉽게 설명하였다. 제21장에서 제31장까지는 4비트 adder, 4비트 subtractor, 4비트 multiplier 등을 ALTERA Quartus II의 VHDL을 사용하여 설계하여 그 결과를 led, 7-segment, vfd 등으로 출력하는 과정에 대하여 알기 쉽게 설명하였다.

목차

1. ALTERA Quartus Ⅱ Web Edition 8.0sp1 개요
2. ALTERA Quartus Ⅱ Web Edition 8.0sp1 Schematic Editor
3. ALTERA Quartus Ⅱ Web Edition 8.0sp1 Compiler
4. ALTERA Quartus Ⅱ Web Edition 8.0sp1 Simulator
5. ALTERA Quartus Ⅱ Web Edition 8.0sp1 Timing Analyzer
6. HBE-COMBO II 트레이닝 키트의 사용법
7. Schematic Editor를 사용하여 설계한 4비트 2진 덧셈기를 HBE-COMBO Ⅱ 트레이닝 키트의 led로 출력하기
8. Schematic Editor를 사용하여 설계한 4비트 2진 덧셈기를 HBE-COMBO Ⅱ 트레이닝 키트의 7-segment로 출력하기
9. Schematic Editor를 사용하여 설계한 4비트 2진 덧셈기를 HBE-COMBO Ⅱ 트레이닝 키트의 vfd로 출력하기
10. Schematic Editor를 사용하여 설계한 4비트 2진 뺄셈기 (2의 보수 사용)를 HBE-COMBO II 트레이닝 키트의 led로 출력하기
11. Schematic Editor를 사용하여 설계한 4비트 2진 뺄셈기(2의 보수 사용)를 HBE_COMBO II 트레이닝 키트의 7-segment로 출력하기
12. Schematic Editor를 사용하여 설계한 4비트 2진 뺄셈기 (2의 보수 사용)를 HBE-COMBO II 트레이닝 키트의 vfd로 출력하기
13. Schematic Editor를 사용하여 설계한 4비트 2진 뺄셈기 (1의 보수 사용)를 HBE-COMBO II 트레이닝 키트의 led로 출력하기
14. Schematic Editor를 사용하여 설계한 4비트 2진 뺄셈기(1의 보수 사용)를 HBE-COMBO II 트레이닝 키트의 7-segment로 출력하기
15. Schematic Editor를 사용하여 설계한 4비트 2진 뺄셈기 (1의 보수 사용)를 HBE-COMBO II 트레이닝 키트의 vfd로 출력하기
16. Schematic Editor를 사용하여 설계한 4비트 2진 곱셈기를 HBE-COMBO II 트레이닝 키트의 led로 출력하기
17. Schematic Editor를 사용하여 설계한 4비트 2진 곱셈기를 HBE-COMBO II 트레이닝 키트의 7-segment로 출력하기
18. Schematic Editor를 사용하여 설계한 4비트 2진 곱셈기를 HBE-COMBO II 트레이닝 키트의 vfd로 출력하기
19. ALTERA Quartus II Web Edition 8.0sp1의 VHDL 문법과 실습
20. VHDL을 사용하여 설계한 4비트 2진 덧셈기를 HBE-COMBO Ⅱ 트레이닝 키트의 led로 출력하기
21. VHDL을 사용하여 설계한 4비트 2진 덧셈기를 HBE-COMBO Ⅱ 트레이닝 키트의 7-segment로 출력하기
22. VHDL을 사용하여 설계한 4비트 2진 덧셈기를 HBE-COMBO II 트레이닝 키트의 vfd로 출력하기
23. VHDL을 사용하여 설계한 4비트 2진 뺄셈기(2의 보수 사용)를 HBE-COMBO II 트레이닝 키트의 led로 출력하기
24. VHDL을 사용하여 설계한 4비트 2진 뺄셈기(2의 보수 사용)를 HBE-COMBO II 트레이닝 키트의 7-segment로 출력하기25. VHDL을 사용하여 설계한 4비트 2진 뺄셈기(2의 보수 사용)를 HBE-COMBO II 트레이닝 키트의 vfd로 출력하기
26. VHDL을 사용하여 설계한 4비트 2진 뺄셈기(1의 보수 사용)를 HBE-COMBO II 트레이닝 키트의 led로 출력하기
27. VHDL을 사용하여 설계한 4비트 2진 뺄셈기(1의 보수 사용)를 HBE-COMBO II 트레이닝 키트의 7-segment로 출력하기
28. VHDL을 사용하여 설계한 4비트 2진 뺄셈기(1의 보수 사용)를 HBE-COMBO II 트레이닝 키트의 vfd로 출력하기
29. VHDL을 사용하여 설계한 4비트 2진 곱셈기를 HBE-COMBO Ⅱ 트레이닝 키트의 led로 출력하기
30. VHDL을 사용하여 설계한 4비트 2진 곱셈기를 HBE-COMBO II 트레이닝키트의 7-segment로 출력하기
31. VHDL을 사용하여 설계한 4비트 2진 곱셈기를 HBE-COMBO II 트레이닝 키트의 vfd로 출력하기

저자소개

저자 이승호는
ㆍ한양대학교 공과대학 전자공학과 공학사
ㆍ한양대학교 대학원 전자공학과 공학석사
ㆍ한양대학교 대학원 전자공학과 공학박사
ㆍIDEC Working Group 참여교수
ㆍ現 국립 한밭대학교 전자ㆍ제어공학과 정교수

도서소개

『디지털 논리회로설계』는 전문대학 또는 대학의 학부과정에서 ALTERA Quartus II의 Schematic Editor와 VHDL을 사용하여 디지털 논리회로를 설계하고 논리적인 이상여부의 검증과 하드웨어 검증을 위해 HBE-CONBO II 트레이닝 키트로 프로그래밍 하는 과정을 풍부한 예제를 중심으로 정리한 책이다. 모두 31장으로 나누어 ALTERA Quartus II를 설치하는 법과 ALTERA FPGA 디바이스 구조에 대하여 설명하고, 설계한 4비트 adder 예제를 ALTERA Quartus II의 Schematic Editor를 사용하여 설계한 후에 HBE- COMBO II 트레이닝 키트에 구현하는 과정에 대하여 알기 쉽게 알려주는 등 다양한 내용을 자세하게 정리하였다.
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